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【VHDL-FPGA-Verilog】 bin2bcd DL : 0: Binary to BCD converter
Update : 2024-05-08 Size : 1024 Publisher : Natacho
【VHDL-FPGA-Verilog】 MultBCD DL : 0: Multiplier BCD - vhdl-Multiplier BCD- vhdl
Update : 2024-05-08 Size : 303104 Publisher : svxiuh
【VHDL-FPGA-Verilog】 7-segment DL : 0: VHDL Design of BCD to 7-segment decoder using PROM
Update : 2024-05-08 Size : 60416 Publisher : FATIMA
【assembly language】 BCD DL : 0: BCD=Boot Configuration Data (启动设置数据) ,BCD是操作系统中的启动设置数据，　　在有vista或windows7的多重操作系统中，系统通bootmgr程序导入BCD文件完成启动菜单的引导。　　可用bcdedit.exe程序来编辑BCD文件，来调整开机默认操作系统和等待时间。 -bcd
Update : 2024-05-08 Size : 3072 Publisher : 廉子
【assembly language】 bcd DL : 0: 实现一位BCD码的加法，并且带有进位。还可以利用逻辑电路实现此功能。-Code to achieve a BCD adder, and a binary. Logic circuits can also be used to achieve this functionality.
Update : 2024-05-08 Size : 3072 Publisher : 廉子
【Other】 bcdto7seg DL : 0: this a code for converting bcd to 7segment in fpga IC-this is a code for converting bcd to 7segment in fpga IC
Update : 2024-05-08 Size : 2048 Publisher : soheil
【Communication】 BCDtoBIN DL : 0: BCD to BIN converter
Update : 2024-05-08 Size : 210944 Publisher : Robee
【OS program】 CNV DL : 0: conversion from hex to ascii, ascii to hex, hex to bcd etc..enjoy
Update : 2024-05-08 Size : 1024 Publisher : nilesh
【assembly language】 bcd DL : 0: Routine to convert to bcd
Update : 2024-05-08 Size : 1024 Publisher : fkimongi
【VHDL-FPGA-Verilog】 BCD DL : 0: BCD数码管显示在DE2平台上运行 quartus-BCD digital display in the DE2 platform quartus
Update : 2024-05-08 Size : 57344 Publisher : johnson
【SCM】 BCD_clock_sim DL : 0: BCD时钟模拟程序包，包括全部PROTEUS工程文件和ASM源代码，基本跟真的一样了-BCD clock simulation package, including all the PROTEUS project documents and ASM source code is really basic with the same
Update : 2024-05-08 Size : 78848 Publisher : 魏桐国
【VHDL-FPGA-Verilog】 BIN_BCD DL : 0: 用硬件描述语音实现二进制数据转换成BCD数据-Using hardware description voice to achieve the binary data into BCD data
Update : 2024-05-08 Size : 620544 Publisher : sleeeeeeep
【VHDL-FPGA-Verilog】 bcd-decoder DL : 0: 用Verilog实现的BCD译码器. 经Quartus||波形仿真无误经硬件验证无误-BCD decoder Realized by Verilog
Update : 2024-05-08 Size : 55296 Publisher : 萧月
【VHDL-FPGA-Verilog】 HEX2BCD DL : 0: 基于fpga的二进制和BCD骂转换模块vhdl描述，只需修改相关参数即可使用-Fpga-based binary and BCD conversion module called vhdl description, simply modify the relevant parameters to use
Update : 2024-05-08 Size : 1024 Publisher : 郭帅
【Windows Develop】 bcd_bit_convert DL : 0: BCD码流（modelsim测试时需使用）转二进制码流（PCM）的matlab代码，给需要的朋友做个参考-BCD code stream (modelsim test to use) to a binary stream (PCM) of matlab code, to be a reference to a friend in need
Update : 2024-05-08 Size : 2048 Publisher : hcf
【VHDL-FPGA-Verilog】 Binary_to_BCD_Converter DL : 0: General Binary-to-BCD Converter The linked code is a general binary-to-BCD Verilog module, and I have personally tested the code.
Update : 2024-05-08 Size : 25600 Publisher : volkan
【VHDL-FPGA-Verilog】 HEX2BCD16 DL : 0: 基于vhdl的二进制转BCD码的设计，已经经过调试，可直接使用-Vhdl based on binary code to BCD design, has been testing can be used directly
Update : 2024-05-08 Size : 1024 Publisher : 郭帅
【STL】 BCD DL : 0: 用于西门子S7200的BCD码的转换，相关的转换代码和控制程序可以我交流。-Siemens S7200 for the conversion of the BCD code
Update : 2024-05-08 Size : 3072 Publisher : LEE
【SCM】 BinaryBCD DL : 0: binary can be change into bcd code ,you can download-binary can be change into bcd code, you can download
Update : 2024-05-08 Size : 33792 Publisher : wang
【VHDL-FPGA-Verilog】 sn7448 DL : 0: verilog实现的“BCD/七段译码器”。-verilog implementation " BCD/Seven-Segment Decoder."
Update : 2024-05-08 Size : 1024 Publisher : 王先生

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