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【VHDL-FPGA-Verilog】 VHDL DL : 0: VHDl在FPGA上实现浮点运算，给初学者使用-VHDL in FPGA to achieve floating-point operations for beginners
Update : 2024-05-19 Size : 145408 Publisher : 司马大方
【VHDL-FPGA-Verilog】 ref-ddr-sdram-vhdl DL : 0: 基于VHDL编写的DDR-SDRAM控制器的编程，目前是业界常用的RAM控制器-VHDL prepared based on the DDR-SDRAM controller programming, is currently the industry s commonly used RAM controller
Update : 2024-05-19 Size : 1031168 Publisher : wfs
【VHDL-FPGA-Verilog】 ref-sdr-sdram-vhdl DL : 0: 基于VHDL编写的SDR-SDRAM控制器的编程，目前是业界常用的RAM控制器-VHDL prepared based on the SDR-SDRAM controller programming, is now commonly used in industry RAM controller
Update : 2024-05-19 Size : 1013760 Publisher : wfs
【VHDL-FPGA-Verilog】 vhdl DL : 0: 基于VHDL的POC编写与实现实现三次握手-VHDL-based preparation and implementation of the POC to achieve three-way handshake
Update : 2024-05-19 Size : 300032 Publisher : 郭红
【VHDL-FPGA-Verilog】 DPLL(VHDL) DL : 0: 使用VHDL语言进行的数字锁相环的设计，里面有相关的文件，可以使用MUX+PLUS打开-The use of VHDL language of digital phase-locked loop design, there are relevant documents, you can use MUX+ PLUS Open
Update : 2024-05-19 Size : 13312 Publisher : 国家
【VHDL-FPGA-Verilog】 +VHDL DL : 0: 很详细用VHDL写的自动售货机程序有详细的说明和设计要求实现功能-Very detailed written using VHDL vending machine procedure is described in detail and design requirements for the realization of function
Update : 2024-05-19 Size : 3072 Publisher : linhua
【VHDL-FPGA-Verilog】 VHDL DL : 0: 采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下： 1.系统主时钟为100 MHz。 2.数据为16位-数据线上连续2次00FF后数据传输开始。 3.系统内部总线宽度为8位。 4.共有4个通道（ch1、ch2、ch3、ch4），每个通道配备100 Bytes的RAM，当存满数据后停止数据采集并且相应通道的状态位产生报警信号。 5.数据分为8位串行输出，输出时钟由外部数据读取电路给出。 6.具备显示模块驱动功能。由SEL信号设置显示的通道，DISPLAY信号启动所选通道RAM中数值的显示过程。数值顺次显示一遍后显示结束，可以重新设定SEL的值选择下一个通道。模块数据线为8位，显示器件为4个8段LED。 7.数据采集模式如下：单通道采集（由SEL信号选择通道），多通道顺次采集（当前通道采满后转入下一通道），多通道并行采集（每通道依次采集一个数据）。模式由控制信号MODE选择，采集数据的总个数由NUM_COLLECT给出。 8.数据采集过程中不能读取，数据读取过程中不能采集-err
Update : 2024-05-19 Size : 5782528 Publisher : pengfu
【VHDL-FPGA-Verilog】 VHDL-Cookbook DL : 0: VHDL快速查看入门手册还有少量精品例子-VHDL Quick View Getting Started manual was also a small number of fine examples
Update : 2024-05-19 Size : 237568 Publisher : Duke
【VHDL-FPGA-Verilog】 VHDL DL : 0: 已经开发成产品的步进电机定位控制系统的VHDL程序-Has developed into a product positioning stepper motor control system VHDL procedures
Update : 2024-05-19 Size : 1024 Publisher : ww
【VHDL-FPGA-Verilog】 VHDL DL : 0: VHDL ieee标准及书籍-VHDL ieee standards and books
Update : 2024-05-19 Size : 1520640 Publisher : haiwaw
【VHDL-FPGA-Verilog】 Fundamentals.of.Digital.Logic.with.VHDL-source.ZIP DL : 0: <数字逻辑与VHDL设计>代码作者：STEPHEN BROWN，ZVONKO VRANESIC 边计年译 -《Fundamentals of Digital Logic with VHDL》 [Brown,Vranesic-2005] code Bian Jinian Translation
Update : 2024-05-19 Size : 23430144 Publisher : bake
【VHDL-FPGA-Verilog】 VHDL-Handbook DL : 0: Vhdl hand book a very good reference for vhdl language describing , syntax of the language with examples to each syntax are explained in details in the book.-Vhdl hand book a very good reference for vhdl language describing , syntax of the language with examples to each syntax are explained in details in the book.
Update : 2024-05-19 Size : 1343488 Publisher : mohamed
【VHDL-FPGA-Verilog】 vga_core(vhdl) DL : 0: vga视频输出（vhdl），主要是从sdram中产生图形，输出到vga中-vga video outputs [vhdl], mainly arising from the SDRAM graphics, output to vga Medium
Update : 2024-05-19 Size : 459776 Publisher : 程荣
【Embeded-SCM Develop】 VHDL DL : 0: 常见的输入输出及存储器件（ram及fifo）vhdl实现-The vhdl source codes of ram,fifo.
Update : 2024-05-19 Size : 22528 Publisher : xugx
【VHDL-FPGA-Verilog】 vhdl-devider DL : 0: 基于vhdl的分频器设计，分频器在数字系统设计中应用频繁-VHDL-based design of the divider, divider in the digital system design applications frequently
Update : 2024-05-19 Size : 1024 Publisher : tony
【SCM】 VHDL DL : 0: 数码管显示，温度传感，红外感应，流水灯蜂鸣器，PS2,RS232的相关VHDL程序，已经在MAX-IIEPM570开发板上测试成功-Digital display, temperature sensor, infrared sensor, water lights buzzer, PS2, RS232 relevant VHDL procedures have been developed at MAX-IIEPM570 the success of on-board test
Update : 2024-05-19 Size : 9216 Publisher : 刘运学
【VHDL-FPGA-Verilog】 VHDL DL : 0: VHDL Programming by Example（McGraw.Hill著）经典国外教程，希望大家喜欢-VHDL Programming by Example (McGraw.Hill a) foreign classics tutorial, I hope everyone likes
Update : 2024-05-19 Size : 1091584 Publisher : wumingxing
【Embeded-SCM Develop】 VHDl DL : 0: 基于VHDL实现的十字路口交通灯功能，其中包括红灯，黄灯，绿灯。-VHDL-based implementation of traffic lights at the crossroads of features, including red, yellow, green.
Update : 2024-05-19 Size : 24576 Publisher : 李国村
【VHDL-FPGA-Verilog】 Mars_EP1C6F_Interface_demo(VHDL) DL : 0: FPGA开发板配套VHDL代码。芯片为Mars EP1C6F。一些接口通信的源码。包括7段数码管、I2C通讯等。-FPGA development board support VHDL code. Chips for the Mars EP1C6F. Some of the source interface. Including 7 digital tube, I2C communications.
Update : 2024-05-19 Size : 6206464 Publisher : chenlu
【VHDL-FPGA-Verilog】 Mars_EP1C6F_Comprehansive_demo(VHDL) DL : 0: FPGA开发板配套VHDL代码。芯片为Mars EP1C6F。综合实验的源码。包括交通灯实验等。-FPGA development board support VHDL code. Chips for the Mars EP1C6F. General experimental source. Experiments, including traffic lights.
Update : 2024-05-19 Size : 805888 Publisher : chenlu

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